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Forum "Technische Informatik"
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Artikel).
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Diskussion
2 Prozessoren mit gleicher ISA
Cache -Index, Offset, Adressen
Paging
Filterkoeffizienten berechnen
Primitiv rekursive Definition
Boolsche Funktionen
adressierbarer Speicher
Empfänger fehlt beim I2C
Can-bus
Ablauftabelle
NAND Umformung Schaltfunktion
Caches
minimale Ü-funktion
D - FlipFlop
Kann gelöscht werden
binäre Addition
Unterschied: Daten/ Befehle
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Zahlendarstellung\Konversion
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DNFs vereinfachen
Flash-Technologie
Schaltungsentwicklung
Zweidimensionale Parität
Logikminimierung mit KV-Diagra
Schaltnetz 2-stufig KNF DNF
RS-FF mittel D-FF
Implikantentafel/ Minimalpoly
KKNF aus KV-Diagrammen
DNF vereinfachen
Wieviel Bits passen in Kabel?
Digitaltechnik
Master Slave FlipFlop
Zweierkomplementdarstellung
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Virtuelle Speicherverwaltung
Register - Schaltung
Zustandsübergangstabelle
äquivalente Funktion mit NAND
Vorteile von NAND/NOR
Volladdierer
Demultiplexer
SR-Latch, problematischer Zust
MIPS Programmierung
Direkte/indexierte Adressierun
Arbeitsspeicher ausrechnen
MOSFET, so richtig?
Speicherzellen
Anzahl binärer Funktionen
IEEE-754 Normalisieren
Zwei Binärzahlen addieren
Dezimalzahl als Binärzahl
RechnerArchitektur Fragen
Bussystem
Konjunktive Normalform
Assembler Befehle
0-Adress Maschine und Java
1-Adress- Maschine
carry lookagead
Von-Neumann-CPU: LSHIFT
Konjunktive Normalform
MOS Transistor Theorieproblem
Neumann Konzept
Einerkomplement der Zahl 14
Oktett in Hexadezimal
Laufzeitverzögerung Gatter
Signal in Register
Digitale Signale
Neue CPI berechnen
I2C Bus Overhead
Shaonscher Entwicklungssatz
Programm von Schicht Ln ->Ln-2
4 D-Flip-Flops-Schaltung
Fixkommadarstellung addition
9er in 3er System
Funktionale Vollständigkeit
Speicherhierarchie
Threads und Monitore
2er komplementdarstellung
Schaltfunktion mit NAND
Halbaddierer mit Nor-Gattern
Quine und McCluskey Verfahren
log. Gleichung -> Schaltung
Leistungsbewertung CPU's
MIPS - Pipelining: Hazards
4-Wege Assoziativcache
Pipeline-Berechnungen
Fragen zu Rechnerarchitektur
Fortran95
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